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SHA-1算法的高速ASIC实现

来源 :微电子学与计算机 | 被引量 : 1次 | 上传用户：wuyinfei1

【摘要】

：

SHA-1算法是一种国际标准的安全杂凑算法.为提高SHA-1算法的吞吐率,提出了一种新的五合一架构,该架构使SHA-1算法的迭代压缩由原来的80轮变为16轮,并可使每轮中某些f函数和部分加法移到关键路径外,从而缩短了关键路径,提高了吞吐率.在SMIC 65nm的工艺下,吞吐率达到12.68Gb/s,高于已发表的同类设计.

【作者】

：

杜晓婧李树国

【机构】

：

清华大学微电子学研究所,清华信息科学与技术国家实验室

【出处】

：

微电子学与计算机

【发表日期】

：

2016年10期

【关键词】

：

SHA-1算法高吞吐率 ASIC实现逻辑化简 SHA-1 algorithm high throughput ASIC implementation

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SHA-1算法是一种国际标准的安全杂凑算法.为提高SHA-1算法的吞吐率,提出了一种新的五合一架构,该架构使SHA-1算法的迭代压缩由原来的80轮变为16轮,并可使每轮中某些f函数和部分加法移到关键路径外,从而缩短了关键路径,提高了吞吐率.在SMIC 65nm的工艺下,吞吐率达到12.68Gb/s,高于已发表的同类设计.

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