【摘 要】
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本文研究了SOC高速数字集成电路测试用Loadboard信号完整性(SI)的问题。提出了一种基于Hyperlynx软件平台对Loadboard信号完整性进行建模和仿真的方法,研究了元件封装、布线
【机 构】
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工业和信息化部电信研究院,北京科技大学计算机与通信工程学院
【基金项目】
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国家科技重大专项(项目编号:2009ZX03006-009)基金资助项目
论文部分内容阅读
本文研究了SOC高速数字集成电路测试用Loadboard信号完整性(SI)的问题。提出了一种基于Hyperlynx软件平台对Loadboard信号完整性进行建模和仿真的方法,研究了元件封装、布线长度、层叠设置、特征阻抗等参数的变化对高频信号产生的影响,从而分析出保证Loadboard电路板SI的设计方法。
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